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Erweiterung Der Simulation Um Die Formale Verifikation Von Schaltungen Mit Analogen Und Gemischt Analog-Digitalen Eingangssignalen
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Neue Lösungsansätze Für Das Generalized-Assignment-Problem
Optimierung Und Performancesteigerung Bei Der Generierung Von Vhdl-Modellen Analoger Schaltungen