Low Power Networks-on-Chip -

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Présentation Low Power Networks - On - Chip Format Broché
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Livre Littérature Générale - 01/11/2014 - Broché - Langue : Anglais

Editeur : Springer Us, New York, N.Y.

Langue : Anglais

Parution : 01/11/2014

Format : Moyen, de 350g à 1kg

Nombre de pages : 308

Expédition : 470

Dimensions : 23.5 x 15.5 x 1.7

ISBN : 9781489994370

Résumé :
In recent years, both Networks-on-Chip, as an architectural solution for high-speed interconnect, and power consumption, as a key design constraint, have continued to gain interest in the design and research communities. This book offers a single-source reference to some of the most important design techniques proposed in the context of low-power design for networks-on-chip architectures.

Sommaire:

Network-on-Chip Power Estimation.- Timing.- synchronous/asynchronous communication.- Network-on-Chip link design.- Topology exploration.- Network-on-Chip support for CMP/MPSoCs.- Network design for 3D stacked logic and memory.- Beyond the wired Network-on-Chip.

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