Low Power Design With High-Level Power Estimation And Power-Aware Synthesis Format Broché

Low Power Design with High-Level Power Estimation and Power-Aware Synthesis - Ahuja, Sumit

Format: Broché
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Auteur(s) : Ahuja, Sumit - Shukla, Sandeep Kumar - Lakshminarayana, AvinashEditeur : Springer Us, New York, N.Y.Langue : AnglaisParution : 01/10/2014Format : Moyen, de 350g à 1kgNombre de...

Auteur(s) : Ahuja, Sumit - Shukla, Sandeep Kumar - Lakshminarayana, Avinash

Editeur : Springer Us, New York, N.Y.

Langue : Anglais

Parution : 01/10/2014

Format : Moyen, de 350g à 1kg

Nombre de pages : 192

Expédition : 300

Dimensions : 23.5 x 15.5 x 1.1

Résumé :
Introduction.- Related Work.- Background.- Architectural Selection using High Level Synthesis.- Statistical Regression Based Power Models.- Coprocessor Design Space Exploration Using High Level Synthesis.- Regression-based Dynamic Power Estimation for FPGAs.- High Level Simulation Directed RTL Power Estimation.- Applying Verification Collaterals for Accurate Power Estimation.- Power Reduction using High-Level Clock-gating.- Model-Checking to exploit Sequential Clock-gating.- System Level Simulation Guided Approach for Clock-gating.- Conclusions.
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Sommaire:
Introduction.- Related Work.- Background.- Architectural Selection using High Level Synthesis.- Statistical Regression Based Power Models.- Coprocessor Design Space Exploration Using High Level Synthesis.- Regression-based Dynamic Power Estimation for FPGAs.- High Level Simulation Directed RTL Power Estimation.- Applying Verification Collaterals for Accurate Power Estimation.- Power Reduction using High-Level Clock-gating.- Model-Checking to exploit Sequential Clock-gating.- System Level Simulation Guided Approach for Clock-gating.- Conclusions.

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